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DS878是一款高速直接數字頻率合成器(DDS)，頻率調諧分辨率為32位，ROM相位分辨率為13位，DAC幅度分辨率為11位。DAC模擬輸出可在正常保持模式（用于第一奈奎斯特頻段）和回零模式（用于第一，第二和第三奈奎斯特頻段）操作之間選擇。DS878和DAC正常保持模式下，可在第一奈奎斯特頻段附近產生最高1.8 GHz的頻率（時鐘速率為3.6 GHz），或在DAC調零模式下產生最高5.4 GHz的第三奈奎斯特頻段。

DS878初始相位可以復位到零度啟動。該芯片有一對互補的模擬輸出，后端為50-∧。輸出波形的頻率可由32個頻率控制位VI[0:31]控制。DS878可接受差分時鐘輸入或單端時鐘輸入，具有50-∧片內后端端子和用戶自定義閾值。頻率分辨率位接受LVTTL或CMOS輸入電平。差分同步輸入SYNCI_P/N為多個芯片應用提供同步，啟動每個芯片準備接受頻率字輸入。

DS878內部產生的同步選通輸入除以8時鐘躍遷沿鎖存器，這些時鐘也發送到SYNCO_P/N。輸出引腳SYNCO_P/N作為參考，頻率字和頻閃輸入時序與內部同步，以8個時鐘分頻，從而正確鎖定。復位是異步的，以最大限度地降低模擬輸出有效性的時鐘延遲。

DS878主要特征

32位次數調諧字

13位ROM相位ip地址解密

老電影中的11位dac

秒表頻段自由高達4.5GHz

模擬網輸入能能在合適穩定各式和零各式左右實現選擇

余弦波行成的1個奈奎斯特帶高達獨角獸2.25GHz，再次個奈奎斯特光波出現一般堅持機制或6.75GHz零化模式，。

在4 GHz秒表傳送速度下，很差的聯通寬帶SFDR近乎50 dBc(dc到2 ghz上行帶寬)

50后面互補原理模擬仿真波形參數打印輸出

多片導入P/N搜集

SyncO_P/N為數據信息彈出和同樣選安全可靠號具備了參考使用。

LVTTL/CMOS數字化方式管控設置

異步回位(RST)引腳教育引導0階段性(IQSL=低)或90(IQSL=高)發動的情況

應用于游戲更新次數Word和DAC轉換頻率的Strobe投入(STRBUP/N)

寬的資料讀取機會允許的DS 878由內存器和微操作器操作，FPGA或DSP集成ic在鐘表頻帶寬度變換的過程中不須打滑的現象或錯誤碼就可不可以自動更新較多8個鐘表周期公式的速率字。

單-5V電源線的能耗為4.3W

64針QFN9x9打包封裝

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